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旨在滿足基于以太網(wǎng)的網(wǎng)絡(luò)應(yīng)用,TI推出LMK5B33414RGCR高性能網(wǎng)絡(luò)同步器

旨在滿足基于以太網(wǎng)的網(wǎng)絡(luò)應(yīng)用,TI推出LMK5B33414RGCR高性能網(wǎng)絡(luò)同步器

來源:本站時間:2024-07-16瀏覽數(shù):

LMK5B33414RGCR器件是具有集成式 2.5GHz 體聲波 VCO 的 14 路輸出、三個 DPLL 和 APLL 網(wǎng)絡(luò)同步器,具有小于 5ns 的計時精度(D 類),旨在滿足基于以太網(wǎng)的網(wǎng)絡(luò)應(yīng)用的嚴格要求。說明:LMK5B33414 網(wǎng)絡(luò)同步器集成了三個 DPLL,可通過可編程環(huán)路帶寬提供無中斷切換和抖動衰…

LMK5B33414RGCR器件是具有集成式 2.5GHz 體聲波 VCO 的 14 路輸出、三個 DPLL 和 APLL 網(wǎng)絡(luò)同步器,具有小于 5ns 的計時精度(D 類),旨在滿足基于以太網(wǎng)的網(wǎng)絡(luò)應(yīng)用的嚴格要求。


說明:

LMK5B33414 網(wǎng)絡(luò)同步器集成了三個 DPLL,可通過可編程環(huán)路帶寬提供無中斷切換和抖動衰減功能,無需外部環(huán)路濾波器,更大限度地提升了靈活性和易用性。每個 DPLL 相位將配對的 APLL 鎖定到基準輸入。


APLL3 具有采用 TI 專有體聲波 (BAW) 技術(shù)的超高性能 PLL,可在 312.5MHz 頻率下生成具有 42fs(典型值)/60fs(最大值)RMS 抖動的輸出時鐘,而不受 DPLL 基準輸入的頻率和抖動特性的影響。APLL2 和 APLL1 提供用于第二或第三頻率域和/或同步域的選項。


基準驗證電路可監(jiān)控 DPLL 參考時鐘,并在檢測到切換事件時在時鐘間執(zhí)行無中斷切換??梢詥⒂昧阊舆t和相位消除,控制從輸入到輸出的相位關(guān)系。


該器件可通過 I2C 或 SPI 接口進行全面編程。板載 EEPROM 可用于自定義系統(tǒng)啟動時鐘。該器件還具有出廠默認的 ROM 配置文件作為備用選項。


LMK5B33414RGCR的特性:

? 基于 BAW VCO 的超低抖動以太網(wǎng)時鐘

- 頻率為 312.5MHz 時 RMS 抖動典型值為 42fs/最大值為 60fs

- 頻率為 156.25MHz 時 RMS 抖動典型值為 47fs/最大值為 65fs

? 3 個高性能數(shù)字鎖相環(huán) (DPLL) 與模擬鎖相環(huán) (APLL) 配對

- 可編程 DPLL 環(huán)路帶寬范圍為 1mHz 至 4kHz

- DCO 頻率調(diào)節(jié)步長 < 1ppt

? 4 個差分或單端 DPLL 輸入

- 1Hz (1PPS) 至 800MHz 輸入頻率

- 數(shù)字保持和無中斷切換

? 14 個采用可編程 HSDS/LVPECL、LVDS 和 HSCL 輸出格式的差分輸出

- 當在 OUT0_P/N、OUT1_P/N、GPIO1 和 GPIO2 上配置 6 個 LVCMOS 頻率輸出以及 12 個差分輸出時,最多總共 18 個頻率輸出

- 支持可編程擺幅和共模的 1Hz (1PPS) 至 1250MHz 輸出頻率

- 符合 PCIe 第 1 代到第 6 代標準

? I2C 或 3 線/4 線 SPI 接口


LMK5B33414RGCR的應(yīng)用:

? 有線網(wǎng)絡(luò)

– 數(shù)據(jù)中心間/內(nèi)部互連

– 計時卡

– 線路卡

– 固定卡(披薩盒)

? SyncE (G.8262)、SONET/SDH(Stratum 3/3E、G.813、GR-1244、GR-253)、IEEE 1588 PTP 輔助時鐘

? 56G/112G PAM-4 串行器/解串器的抖動消除、漂移衰減和基準時鐘生成

? 100G-800G 數(shù)據(jù)中心交換機、核心路由器、邊緣路由器、WLAN

? 數(shù)據(jù)中心和企業(yè)級計算

– 智能網(wǎng)絡(luò)接口卡 (NIC)

? 光傳輸網(wǎng)絡(luò) (OTN G.709)

? 寬帶固定線路接入

? 工業(yè)

– 測試和測量

– 醫(yī)療成像


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